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HDB3编码器设计

  • 简介:(论文 页数:9 字数:2851 带程序)第1章 HDB3编码器的仿真概述 1.1 引言 数字基带信号的传输是数字通信系统的重要组成部分。在数字通信中,有些场合可不经过载波调制和解调过程,而对基带信号进行直接传输。采用AMI码的信号交替反转,有可能出现四连零现象,...
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(论文 页数:9 字数:2851 带程序)第1章 HDB3编码器的仿真概述

1.1 引言
数字基带信号的传输是数字通信系统的重要组成部分。在数字通信中,有些场合可不经过载波调制和解调过程,而对基带信号进行直接传输。采用AMI码的信号交替反转,有可能出现四连零现象,这不利于接收端的定时信号提取。而HDB3码因其无直流成份、低频成份少和连0个数最多不超过三个等特点,而对定时信号的恢复十分有利,并已成为CCITT协会推荐使用的基带传输码型之一。为此,本文利用VHDL语言对数据传输系统中的HDB3编码器进行了设计。


1.2 HDB3码的编码规则
HDB3码是AMI码的改进型,称为三阶高密度双极性码,它克服了AMI码的长连0串现象。

HDB3码的编码规则为先检查消息代码(二进制)的连0串,若没有4个或4个以上连0串,则按照A MI码的编码规则对消息代码进行编码;若出现4个或4个以上连0串,则将每4个连0小段的第4个0变换成与前一非0符号(+1或-1)同极性的V符号,同时保证相邻V符号的极性交替(即+1记为+V,-1记为-V);接着检查相邻V符号间非0符号的个数是否为偶数,若为偶,则将当前的V符号的前一非0符号后的第1个0变为+B或-B符号,且B的极性与前一非0符号的极性相反,并使后面的非0符号从V符号开始再交替变化。


2.1 HDB3编码器的仿真
2.1.1 编码原理
以四连“0”的可能性通过如表1所列的多“0”消息代码进行分析,并利用EDA工具对VHDL源程序进行编译、适配、优化、逻辑综合与仿真。仿真结果显示其完全可以达到编码要求。而将HDB3编码硬件描述下载到CPLD或FPGA目标芯片中,然后连接好CC4052进行实际应用测试。
(以上为三级标题,黑体,四号,左对齐。)

2.1.2 数字基带信号的码形
数字基带信号的码型设计原则
所谓数字基带信号,就是消息代码的电脉冲表示――电波形。在实际基带传输系统中,并非所有的原始数字基带信号都能在信道中传输,例如,含有丰富直流和低频成分的基带信号就不适宜在信道中传输,因为它有可能造成信号严重畸变;再例如,一般基带传输系统都是从接收到的基带信号中提取位同步信号,而位同步信号却又依赖于代码的码型,如果代码出现长时间的连 “0” 符号,则基带信号可能会长时间出现 0 电位,从而使位同步恢复系统难以保证位同步信号的准确性。实际的基带传输系统还可能提出其它要求,从而导致对基带信号也存在各种可能的要求。归纳起来,对传输用的基带信号的要求主要有两点:
( 1 )对各种代码的要求,期望将原始信息符号编制成适合于传输用的码型;
( 2 )对所选的码型的电波形的要求,期望电波形适宜于在信道中传输。前一问题称为传输码型的选择,后一问题称为基带脉冲的选择。这是两个既彼此独立又相互联系的问题,也是基带传输原理中十分重要的两个问题。本节讨论前一问题,后一问题将在下面几节中讨论。

 

 

目录

1 HDB3编码器的仿真概述
1.1 引言
1.2 HDB3码的编码规则
2. HDB3编码器的仿真
2.1.1编码原理
2.1.2数字基带信号的码形
2.2 HDB3编码器的VHDL建模与程序设计
2.2.1插“V”模块的实现
2.2.2 插“B”模块的实现
2.2.3 单极性变双极性的实现
3 HDB3编码器的仿真

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