| 设计思路：首先设计序列发生器，序列发生器有很多设计方法，我采用了比较容易懂的计数器作为辅助的设计方法，设计了7个状态的计数器，然后分配状态，使输出为1110100，这就完成了序列发生器的设计。其次设计串/并行码变换器，由于序列信号为7位，所以我设置了8个寄存器构成串入并出移存器，其中7个寄存器用于移位、寄存串入的数据，另一个作为标志位用于记录7位数据是否全部移进移存器，一旦移存器侦测7位数据全部进入，则使5位数据立即并行输出。而串行输入数据在移进移存器的过程中，使移存器的并行输出为“0000000”。 我设置了了一个标志位temp_date（0）及设置标致信号“0111111”，在并行输出状态的下一状态执行：“temp_date |
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