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课程设计 利用VHDL语言设计的数字钟

  • 简介:《PLD技术》课程设计 利用VHDL语言设计的数字钟,共10页,1170字,一、题目:数字钟,二、设计目的,掌握各类计数器和分频器以及它们相连的设计方法;掌握多个数码管的原理与方法;掌握CPLD技术的层次化设计的方法;掌握使用VHDL语言的设计思想;对整个系统的...
    类型:word    页数:10    字数:1170   
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适用专业:PLD技术
适用年级:大学
论文编号:11015

论文简介:
《PLD技术》课程设计 利用VHDL语言设计的数字钟,共10页,1170字
一、题目:数字钟
二、设计目的
掌握各类计数器和分频器以及它们相连的设计方法;掌握多个数码管的原理与方法;掌握CPLD技术的层次化设计的方法;掌握使用VHDL语言的设计思想;对整个系统的设计有一个了解。
三、设计系统环境
(1)一台PC机;
(2)一套GW48型EDA实验开发系统硬件;
(3)X+PLUS Ⅱ集成化的开发系统硬件。
.......


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  • 课程设计-利用VHDL语言设计的数字钟
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